1、根据项目需求完成参与芯片方案制定;
2、负责模块级的verilog RTL实现;
3、编写验证平台,完成模块级的仿真验证;
4、协助系统级的bug调试;
5、负责部分设计、开发、测试等相关文档的编写,整理和归档并提供相应的技术支持;
任职要求:
1、2021年硕士及以上学历毕业,计算机、电子类、电气类、自动化、通信相关专业,有创新精神;
2、熟悉FPGA、数字电路、C/C 语言;
3、有一定的大数据、机器学习理论基础者优先;
4、具有较强的学习能力、抗压能力和沟通协作能力。
5、工作地点:北京,济南,西安
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